Zilog Z16C35 Instrukcja Użytkownika Strona 157

  • Pobierz
  • Dodaj do moich podręczników
  • Drukuj
  • Strona
    / 322
  • Spis treści
  • BOOKMARKI
  • Oceniono. / 5. Na podstawie oceny klientów
Przeglądanie stron 156
Application Note
Interfacing Z80
®
CPUs to the Z8500 Peripheral Family
6-3
6
Write Cycle Timing
Figure 2 illustrates the Z8500 Write cycle timing. All
register addresses and /INTACK must remain stable
throughout the cycle. If /CE goes active after /WR goes
active, or if /CE goes inactive before /WR goes inactive,
then the effective Write cycle is shortened. Data must be
available to the peripheral prior to the falling edge of /WR.
Figure 1. Z8500 Peripheral I/O Read Cycle Timing
Figure 2. Z8500 Peripheral I/O Write Cycle Timing
Page 151 of 316
UM011002-0808
Przeglądanie stron 156
1 2 ... 152 153 154 155 156 157 158 159 160 161 162 ... 321 322

Komentarze do niniejszej Instrukcji

Brak uwag